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题目
Which of the following descriptions about low power is not correct?
A. Modern design tools support automatic clock gating, such as Design Compiler.
B. Power gating is a power-saving technique that shuts down parts of the device during period of inactivity
C. The signals from a power off block to a power on block must be isolated.
D. Clock gating technique can reduce the leakage power of the device.
参考答案与知识点
参考答案
正确答案为 D。时钟门控（Clock Gating）技术通过在寄存器或触发器不需要时钟时关闭时钟来减少动态功耗（开关功耗）。它主要影响电路切换时的功耗，而泄漏功耗（漏电流功耗）主要取决于晶体管的亚阈值电流、栅极泄漏电流等，与时钟是否翻转无关。因此，时钟门控并不能减少泄漏功耗。选项 A 正确，现代 EDA 工具如 Synopsys Design Compiler 支持自动插入时钟门控。选项 B 正确，电源门控（Power Gating）通过切断部分模块的电源来消除其泄漏功耗。选项 C 正确，对从断电域到常电域的信号必须使用隔离单元（Isolation Cell）将输出钳位到安全电平，防止浮空输入导致常电模块的漏电或逻辑错误。
涉及知识点
- 时钟门控降低动态功耗
- 电源门控降低泄漏功耗
- 跨电源域信号隔离要求
- 动态功耗与泄漏功耗区别
- EDA工具支持低功耗技术